(2007)某时序电路如图3.6-21所示，其中R(来学网)、R和R均为8位移位寄存器，其余电路分别为全加器和D触发器，则该电路具有（ ）。
  • A.
    (来学网)实现两组8位二进制串行乘法功能
  • B.
    (来学网)实现两组8位二进制串行除法功能
  • C.
    (来学网)实现两组8位二进制串行加法功能
  • D.
    (来学网)实现两组8位二进制串行减法功能
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